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Erhöhung des effektiven nutzbaren Bits vom AD Wandler



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20.09.2011, 16:50
Beitrag #1

Irina Offline
LVF-Neueinsteiger


Beiträge: 1
Registriert seit: Aug 2011

2010
2010
DE_EN



Erhöhung des effektiven nutzbaren Bits vom AD Wandler
Hallo zusammen,

ich habe keine ähnlichen Themen gefunden, deswegen habe ich ein neus erstelltSmile

Ich beschäftige mich mit der FPGA-Entwicklung in LabVIEW. Zur Verfügung stehen NI PXI-Systeme mit FPGA-Modulen. Ich benutze momentan das Modul NI PXI-7853R, weil es da auch die benötigen AD-und DA- Wandler gibt. Momentan habe ich eine ganz interessante AufgabeSmile Ich möchte die Auflösung des AD-Wandler erhöhen. Der vorhandene Wandler hat 16 bit Auflösung mit 750 kHz Abtastrate. Ich brauche aber die bessere Auflösung. Dann habe ich nach Lösungen gesucht und eine interessante gefunden. Ich kann so schnell wie möglich abtasten (dann ist es 750kHz sehr gut) und mit der kombination aus Mittelwertbildung und Downsampling kann man die effektive Auflösung erhöhen und rauschen verringern. Also möchte ich das jetzt testenSmile

Deswegen möchte ich fragen, vielleicht ist dieses Problem schon bekannt und es gibt interessante Ideen. Oder könnte jemand mir erzählen, wie ich "Downsampling" in diesem Fall in LabVIEW besser realisieren könnte.


Viele Grüße und einen schönen Tag!

Irina
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