Verständnis Frage zu FPGA

while/for schleife -> 2 ticks overhead
SCTL (single cycle timed loop) -> 1 tick pro iteration!

Was du in deinem fall der pwm machen willst ist, dass du eine SCTL nimmst und diese entsprechend mit der base clock or derived clock konfigurierst und dir im weiteren eine kleine statemachine innerhalb dieser SCTL ablegst. Ein state -> idle und der andere state enthaelt die PWM logic.