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Hoodi · 29.04.2014, 07:57

Hallo Ihr,

ich bin noch Neuling und probiere gerade folgendes zu entwerfen:

-Endliche Pulserzeugung (Duty-Cycle: 50%)
-Frequenz und Anzahl der Pulse soll auf RT Ebene eingelesen werden.

Anbei habe ich mal ein VI, die Simulation klappt auch.
Da ich aber KEINE Ahnung von FPGA habe, wäre ich sehr dankbar ob Ihr mir sagen könntet ob mein VI so funktioniert! Oder was ich von der Programmierung zu beachten habe.

Anbei das aktuelle Snippet Wink

Viele Grüße

Hoodi

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Endliche Pulserzeugung mit myRIO (FPGA)