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**chrissyPu** · 01.09.2008, 13:53

Hi,

ich habe gerade (vielleicht etwas unvorsichtig...) mein System auf LabVIEW 8.6. samt den Entsprechenden RIO 3.0, FPGA- und RT-Modulen upgegraded. Vorher hatte ich in LabVIEW 8.2.1. mit entsprechenden Modulen mein FPGA-System programmiert und getestet. Die Auslastung meines FPGA (7830R) lag so im Bereich von 60-80% der vorhandenen Logic Slices.

Jetzt, LabVIEW 8.6. gestartet, compiliert, Abbruch, da er auf einmal 320% der Logic Slices belegen wollte. Software wurde in der zwischenzeit nicht geändert (vom Verschieben einiger Kommentare vielleicht mal abgesehen...).

Hat jemand ggf. ähnliche Erfahrungen gemacht? Wäre über Ideen dankbar...

Grüße,

chrissyPu

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