INFO: Dieses Forum nutzt Cookies...
Cookies sind für den Betrieb des Forums unverzichtbar. Mit der Nutzung des Forums erklärst Du dich damit einverstanden, dass wir Cookies verwenden.

Es wird in jedem Fall ein Cookie gesetzt um diesen Hinweis nicht mehr zu erhalten. Desweiteren setzen wir Google Adsense und Google Analytics ein.


Antwort schreiben 

synchronisation auf clock signal



Wenn dein Problem oder deine Frage geklärt worden ist, markiere den Beitrag als "Lösung",
indem du auf den "Lösung" Button rechts unter dem entsprechenden Beitrag klickst. Vielen Dank!

03.11.2010, 10:05
Beitrag #1

talarion Offline
LVF-Grünschnabel
*


Beiträge: 11
Registriert seit: Nov 2010

9.0.1
2010
EN


Deutschland
synchronisation auf clock signal
hi!

ich arbeite seit kurzen im rahmen eines praxissemesters mit labview. hierbei geht es um das auswerten eines boardcomputers eines flugzeugs.
ich habe hier ein NI PXI-1031 mit diversen karten, momentan verwende ich die PXI-6224. diese ist über ein scb68 an den teststand des boardcomputers angeschlossen, wo ich die ausgangssignale direkt abgreifen kann.
die ausgangssignale sehen folgendermassen aus: ich bekomme ein datensignal, auf dem seriel ein bitstrom übertragen wird. dazu kommt ein clock signal, auf dessen positiven flanken die bits des datensignals getriggert sind. bei jeder positiven flanke des clocksignals, bin ich in der mitte eines bits des datensignals. zur verdeutlichung habe ich eine grafik angehängt. beide signale habe ich dann noch in invertierter form zur verfügung, also insgesammt 4 datenleitungen.
ich bin nun so weit, dass ich die datenbits auf die clockimpulse triggern kann, und den seriellen strom in ein byte einlesen kann. auf der datenleitung werden sequentiell mehrere datenwörter übertragen, immer durch einen synch-break voneinander getrennt. nachdem alle datenwörter durchgelaufen sind, geht das ganze wieder von vorne los und immer so weiter. jetzt steh ich aber vor dem problem, dass ich die datenwörter immer am snych-break beginnend einlesen muss, d.h. ich muss diesen break irgendwie im datenstrom finden. in der grafik sieht man zb, dass die daten immer höchstens die halbe frequenz des synch-breaks haben. die daten sind im NRZ format, die frequenz kann also variieren. der synch-break ist auch nichts anderes als ein ausschnitt des clock signals.
meine ansätze bisher waren zb, das datensignal mit dem clocksignal zu vergleichen. da diese nur im synch-break gleich sind, sollte man diese stelle so finden können. ein anderer ansatz war, die frequenz im datensignal zu messen, und wenn diese die frequenz des clocksignals erreicht, ist die stelle auch wieder gefunden. aufgrund mangelnder kenntnnisse mit labview, konnte ich beide ansätze nicht umsetzten. vielleicht kann mir hier jemand dabei helfen, oder hat einen viel eleganteren weg parat, wie ich diese breaks finden kann. ich hoffe es ist einigermassen klar, was ich beschrieben hab.

danke schonmal!

ciao!


Angehängte Datei(en) Thumbnail(s)
   
Alle Beiträge dieses Benutzers finden
Diese Nachricht in einer Antwort zitieren to top
03.11.2010, 10:39
Beitrag #2

jg Offline
CLA & CLED
LVF-Team

Beiträge: 15.864
Registriert seit: Jun 2005

20xx / 8.x
1999
EN

Franken...
Deutschland
synchronisation auf clock signal
Offtopic2
Bitte LVF-Regeln lesen und in Zukunft beachten, in diesem Fall geht es um den letzten Abschnitt. Beiträge, die (fast) ohne Verwendung der Shift-Taste erstellt wurden, sind einfach schlecht lesbar. Das mögen wir hier im LVF nicht.

Gruß, Jens

Wer die erhabene Weisheit der Mathematik tadelt, nährt sich von Verwirrung. (Leonardo da Vinci)

!! BITTE !! stellt mir keine Fragen über PM, dafür ist das Forum da - andere haben vielleicht auch Interesse an der Antwort!

Einführende Links zu LabVIEW, s. GerdWs Signatur.
Alle Beiträge dieses Benutzers finden
Diese Nachricht in einer Antwort zitieren to top
03.11.2010, 10:47
Beitrag #3

oenk Offline
LVF-Stammgast
***


Beiträge: 361
Registriert seit: May 2005

>= 7.1
2004
EN

3018
Schweiz
synchronisation auf clock signal
Du kannst dir einen Trigger erstellen, der auf ein digitales Pattern hin startet (des Sync-Breaks). Ab dann folgt es wohl immer dem gleichen Schema, oder sollte es zumindest.
SoUndSoViel Daten bits, soUndSoViel SyncBits, etc pp.
Sind die Wörter unterschiedlich lang sieht die Sache ganz anders aus. Dann bleibt IMHO nur post-processing. Re-triggering on the fly funktioniert meiner Erfahrung nach nicht, oder nicht ohne Datenverlust (zumindest bei NI-HSDIO, wie es mit DAQmx aussieht weiss ich nicht)

Wenn du die Clock deines Devices auf die Clock des DUT synchronisierst spielt eine Schwankung der Clock auch keine Rolle (sofern dies die 6224 Karte unterstüzt).

In theory, there is no difference between theory and practice; In practice, there is.

Chuck Reid
Alle Beiträge dieses Benutzers finden
Diese Nachricht in einer Antwort zitieren to top
03.11.2010, 12:47
Beitrag #4

talarion Offline
LVF-Grünschnabel
*


Beiträge: 11
Registriert seit: Nov 2010

9.0.1
2010
EN


Deutschland
synchronisation auf clock signal
Wenn ich nach einen digitalen Pattern suche, dann schaut sich das VI doch nur die Flanken an, oder? Das Problem hierbei ist, dass im Dantensegment eben die gleiche Bitfolge auftauchen kann, Unterschied ist allein die Frequenz.
Bei dem VI DAQmx Trigger z.B. kann ich nur Flanken und Pegel als Muster angeben, aber das Hilft mir nicht weiter. Es muss also irgend eine andere Lösung her. Ich hab auch schon versucht, das digitale Signal in ein analoges umzuwandeln, und in diesem dann die Frequnz zu messen. Nach den Umwandlung hab ich aber kein Signal mehr...
Danke schonmal für die Hilfe soweit!

Ciao!
Alle Beiträge dieses Benutzers finden
Diese Nachricht in einer Antwort zitieren to top
04.11.2010, 08:22
Beitrag #5

talarion Offline
LVF-Grünschnabel
*


Beiträge: 11
Registriert seit: Nov 2010

9.0.1
2010
EN


Deutschland
synchronisation auf clock signal
Wie könnte ich denn z.B. die Zeit zwischen zwei positiven Flanken messen? Oder die Pulsbreite bei einem digitalen Signal?
Alle Beiträge dieses Benutzers finden
Diese Nachricht in einer Antwort zitieren to top
04.11.2010, 09:54
Beitrag #6

Achim Offline
*****
*****


Beiträge: 4.223
Registriert seit: Nov 2005

20xx
2000
EN

978xx
Deutschland
synchronisation auf clock signal
Benutz mal den ExampleFinder...

"Is there some mightier sage, of whom we have yet to learn?"

"Opportunity is missed by most people because it is dressed in overalls and looks like work." (Thomas Edison)
Alle Beiträge dieses Benutzers finden
Diese Nachricht in einer Antwort zitieren to top
Anzeige
05.11.2010, 09:33 (Dieser Beitrag wurde zuletzt bearbeitet: 05.11.2010 09:56 von talarion.)
Beitrag #7

talarion Offline
LVF-Grünschnabel
*


Beiträge: 11
Registriert seit: Nov 2010

9.0.1
2010
EN


Deutschland
synchronisation auf clock signal
Ich habe schon nach ähnlichen Beispielen gesucht, aber nichts gefunden das mir weiterhilft. Ich hab mich auch schon eine ganze Weile mit dem Problem beschäftigt, bevor ich hier Das Topic erstellt hab, aber mittlerweile weiss ich einfach nicht mehr weiter. Der Vergleich der beiden Signale geht schief, weil ich ja das Datensignal auf das Clocksignal getriggert hab, damit seh ich die Flanken im Datensignal nicht mehr, soblad der synch-break kommt. Der andere Ansatz mit der Frequenzmessung haut auch nicht hin, ich schaffs nicht, die Impulse zu messen. Ich hab mal ein VI hochgeladen, in dem ich das digitale Signal in ein analoges wandle, aber nach der Wandlung hab ich kein Signal mehr.
Ich würd mich freuen, wenn mir jemand mit der Frequenzmessung hilft, oder vielleicht hat ja jemand einen ganz anderen Ansatz, wie man das Problem lösen kann. Worum es geht steht ja im ersten Beitrag.

Danke schonmal für eure Hilfe!

EDIT:
zum VI: Ich habe dort zwei Tasks erstellt, die jeweils eine Leitung der PXI-6224 Karte lesen. Auf einer Leitung liegt das Datensignal an, auf der anderen das Clocksignal. In diesem Beispiel sind die beiden Signale aber nicht aufeinander getrifggert, da es mir hier nur mal um die Umwandlung in ein analoges Signal ging. Die Anzeigen bekommen aber kein Eingangssignal mehr.

LV Version 8.6


Angehängte Datei(en)
Sonstige .vi  digitalnachanalog.vi (Größe: 12,97 KB / Downloads: 228)
Alle Beiträge dieses Benutzers finden
Diese Nachricht in einer Antwort zitieren to top
Antwort schreiben 


Möglicherweise verwandte Themen...
Themen Verfasser Antworten Views Letzter Beitrag
  Synchronisation PXIe und cDAQ Bärbel 4 4.075 13.01.2021 12:26
Letzter Beitrag: Bärbel
  Master Timebase and Reference Clock Sharing VS_03 1 3.971 24.08.2016 08:56
Letzter Beitrag: VS_03
  cRIO und DAQmx Synchronisation oder Trigger? gibsonuser 8 6.581 27.08.2015 06:42
Letzter Beitrag: cb
  Hardwarefehler bei Synchronisation mit cDAQ MM 7 6.648 06.08.2015 20:40
Letzter Beitrag: MM
  Synchronisation von Messungen auf 2 Rechnern dave1 13 12.880 20.04.2015 10:41
Letzter Beitrag: GerdW
  Sample Clock Management Florian Sim 2 5.095 23.03.2015 17:18
Letzter Beitrag: Florian Sim

Gehe zu: